适用于XilinxZynq平台的AES硬件引擎_C_Verilog_下载.zip
GNURadio支持基于XilinxZynq的FPGA加速器_Python_C++_下载.zip
xilinx zynq Digilent Zedboard
基于xilinxzynq在zedboard上实现的实时图像直方图均衡器_C++_Python_下载.zip
使用在XilinxZynq平台上运行的lwIPRAWAPI的UDP和TCP回显服务器_VHDL_C_下载.zip
Vivado2018.1项目基于硬件加速(FPGA)SLINK聚类算法为XilinxZynq-7000SoC(Zybo板.zip
来自BonnieToy的Linpack来源。稍作修改以在XilinxZynq-7000EPP中针对ARM处理器进行编译_.zip
在带有ARMCortex-A9CPU+FPGA的XilinxZynq7000系列SOC上为Yocto构建工具_Docke.zip
引导xilinxzynq工具链。只需插入设备,运行脚本,一切都会自行处理。;)_Tcl_Shell_下载.zip
学习ZYNQ的好东东,目前最热门的资源
本报告中描述的参考平台使用XilinxZYNQ-7000硬件平台ZC702作为实时处理元件,应用于使用方向梯度直方图(H.zip
xilinx zynq Digilent Zedboard _XilinxZYNQ_zynq_zedboard.zip
xilinx zynq Digilent Zedboard _XilinxZYNQ_zynq_zedboard_源码.zip
matlab代码变成.exe Windows Caffe 这是一个由Guillaume Dumont(@willyd)领导的基于社区的实验性分支。 这是一个进行中的工作。 Caffe的此分支将框架移植到Windows。 Travis(Linux构建) AppVeyor(Windows构建)...
Xilinx Zynq®-7020 SoC是一款高性能、低功耗的可编程逻辑器件,它集成了双核ARM Cortex-A9处理器和Xilinx 7系列FPGA。以下是Xilinx Zynq®-7020 SoC的引脚图: ```shell 请注意:此处无法插入图片,如需查看引脚图...
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Xilinx:registered:Zynq:registered:-7000 平台的 HDL Coder:trade_mark: 支持包支持生成可使用 Xilinx Vivado:registered: 或 Xilinx ISE 集成到 FPGA 设计中的 IP 核。 当与适用于 Xilinx Zynq-7000 平台的 ...
MIMO zynq RFSOC 27DR 8发8收 小尺寸
第1章1、下列哪个选项不是LINUX所支持的? ( )A、多用户 B、超进程 C、可移植 D、多进程2、LINUX就是所谓的“FREE SOFTWRAE”,这个“FREE”的含义是什么? ( )A、LINUX不需要付费 B、LINUX发行商不能向用户收费C、...
Xilinx Zynq-7000 嵌入式系统设计与实现 基于ARM Cortex-A9双核处理器和Vivado的设计方法 目录 第1章Zynq-7000 SoC设计导论1.1全可编程片上系统基础知识1.1.1全可编程片上系统的演进1.1.2SoC与MCU和CPU的比较...
第17章 SPI控制器 注:本文为笔者自己翻译的XILINX ZYNQ-7000 SOC UG-585官方文档,文档版本UG585 (v1.12.2) July 1, 2018 文章目录第17章 SPI控制器17.1 简介17.2 功能描述17.3 配置步骤1.引入库2....
第2章 信号、接口和引脚 注:本文为笔者自己翻译的XILINX ZYNQ-7000 SOC UG-585官方文档,文档版本UG585 (v1.12.2) July 1, 2018 文章目录第2章 信号、接口和引脚2.1 介绍2.2 电源引脚2.3 PS I/O引脚2.4 PS-PL电平...
1 SPI通信协议 SPI是串行外设接口(Serial Peripheral Interface)的缩写,是 Motorola 首先提出的全双工三线同步串行外围接口。 采用主从模式(Master Slave)架构,支持多 slave模式应用,一般仅支持单 Master。...
**1.内核中的定时器依赖硬件定时器。**硬件定时器产生固定的频率并产生中断。 命令 petalinux-config -c kernel 选中Kernel Features按回车进入 回车进去,选择100Hz ,每秒100个节拍 **2....1.void init_timer...